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黄勇叶先生

PCB 2/4层板首单立减110元，立即领券

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差分对内等长多串

小发发 6 天前 2 回答 833阅读

用allegro生成的Gerber文件后，TOP.art文件中为什么会丢失了一部分焊盘和走线？ attach_img

yaoxinyu 03-26 17:21 3 回答 18324阅读

cadence16.6生成网络表出问题，哪位大神帮忙指点一二

蜗牛 11-27 11:04 7 回答 41245阅读

差分线对动态补偿 attach_img

专业张阳阳 11-14 14:19 2 回答 10480阅读

cadence 设置差分出线方式

小发发 10-31 10:45 6 回答 10114阅读

求助！allegro16.6中英文对照！ attach_img

上善若水120 10-20 10:23 144 回答 24488阅读

allegro pcb 导出 dxf时怎样可以导出螺丝孔的内径

jf_48881181 10-16 10:27 1 回答 11847阅读

求助：allegro中无法设置PIN使用米字连接到铜皮

aifo 10-13 10:37 1 回答 11982阅读

allegro 导入网表问题警告

吴华帮 10-13 09:43 1 回答 10932阅读

新人疑问：如何获得积分？

humamail 10-12 09:45 77 回答 15992阅读

求助ORCAD零件属性显示问题 attach_img

王建1201 10-10 17:51 2 回答 4884阅读

allgero重新导网表之后铜皮出现分割现象是什么原因呢？ attach_img

王钰 10-09 16:51 1 回答 11570阅读

关于四层板阻抗匹配问题 attach_img

金沙滩 09-24 17:11 30 回答 24593阅读

求救！ cadence 的PCB editor 无法放置元器件～

段政 08-31 15:32 2 回答 10294阅读

allegro封装原点设置

张国富 06-14 17:17 4 回答 12128阅读

allergo显示网络和放置焊盘元器件闪烁卡顿

jf_98378219 05-08 17:15 4 回答 12341阅读

关于螺钉孔敷铜问题

jf_98584191 04-13 13:19 0 回答 9746阅读

Model Integrity 进行IBIS转DML时总是报错 ibis2signoise failed Could not create xx.dml Please refer to Logfile for details!

jf_18210233 03-23 14:33 0 回答 10230阅读

请大佬们帮忙brd文件转换为gerber文件。

jf_22860783 03-06 11:53 3 回答 10920阅读

这种图是怎么做的，应该导出什么格式 attach_img

rabbitfix 02-27 23:11 0 回答 10822阅读

网络表导入就去了，却什么也没有？ attach_img

lzp961 01-12 14:05 2 回答 41278阅读

ALLEGRO DRC错误T/P，求指导

张静楠 11-29 17:50 0 回答 18299阅读

allegro 画的PCB，在做database check检查时报ROU2218错误求大神导

紅尘隨心 11-29 16:26 1 回答 24158阅读

allegro框选时框选框跟不上鼠标速度 attach_img

lr 11-22 17:16 3 回答 38300阅读

allegro 盲孔资料怎么出？

gdutchen 11-15 08:44 0 回答 27466阅读

CIS配置后missing Schematic Part

gdutchen 11-13 15:02 0 回答 24042阅读

使用orcad自制元件OK后，重新打开发现元件一脚莫名集中在一点，且引脚显示为zero length，这是为什么

张开灿 11-05 10:13 4 回答 55658阅读

怎么办

学森自行车vbnm 10-28 16:15 0 回答 33799阅读

PSpice仿真出现错误，求大神指点

葛小馬 10-27 14:01 1 回答 44911阅读

找杜正阔一本书，书名叫 cadence Allegro 实战攻略与高速PCB设计；书的封面见附件图片： attach_img

chaoyueTX 09-30 16:16 10 回答 41580阅读

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